brainfuck_processor/BFPU.circ

604 lines
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<lib desc="#Wiring" name="0">
<tool name="Splitter">
<a name="facing" val="south"/>
</tool>
<tool name="Pin">
<a name="appearance" val="classic"/>
</tool>
<tool name="Tunnel">
<a name="facing" val="south"/>
</tool>
<tool name="Constant">
<a name="value" val="0x0"/>
</tool>
</lib>
<lib desc="#Gates" name="1">
<tool name="OR Gate">
<a name="inputs" val="4"/>
</tool>
</lib>
<lib desc="#Plexers" name="2"/>
<lib desc="#Arithmetic" name="3"/>
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<lib desc="#I/O" name="5"/>
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<lib desc="#TCL" name="7"/>
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<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
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<mappings>
<tool lib="8" map="Button2" name="Poke Tool"/>
<tool lib="8" map="Button3" name="Menu Tool"/>
<tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="8" name="Poke Tool"/>
<tool lib="8" name="Edit Tool"/>
<tool lib="8" name="Wiring Tool"/>
<tool lib="8" name="Text Tool"/>
<sep/>
<tool lib="0" name="Pin"/>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
</tool>
<sep/>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
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<tool lib="4" name="D Flip-Flop"/>
<tool lib="4" name="Register"/>
</toolbar>
<circuit name="main">
<a name="appearance" val="logisim_evolution"/>
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<a name="circuitnamedboxfixedsize" val="true"/>
<a name="simulationFrequency" val="1.0"/>
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<a name="value" val="0x0"/>
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<comp lib="0" loc="(120,830)" name="Tunnel">
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<comp lib="0" loc="(1210,740)" name="Constant">
<a name="width" val="8"/>
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<comp lib="0" loc="(1260,370)" name="Constant">
<a name="width" val="8"/>
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<comp lib="0" loc="(1390,440)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Eingabe"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(1420,890)" name="Splitter">
<a name="facing" val="west"/>
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<comp lib="0" loc="(1450,580)" name="Tunnel">
<a name="label" val="cells"/>
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<comp lib="0" loc="(1460,480)" name="Splitter">
<a name="facing" val="west"/>
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<comp lib="0" loc="(1520,320)" name="Constant"/>
<comp lib="0" loc="(1550,250)" name="Tunnel">
<a name="facing" val="south"/>
<a name="label" val="cells"/>
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<comp lib="0" loc="(1580,860)" name="Constant"/>
<comp lib="0" loc="(1590,330)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(1640,880)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(170,730)" name="Splitter">
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(170,840)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="JMP"/>
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<comp lib="0" loc="(1850,250)" name="Splitter">
<a name="fanout" val="8"/>
<a name="incoming" val="8"/>
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<comp lib="0" loc="(1930,330)" name="Tunnel">
<a name="facing" val="south"/>
<a name="label" val="load"/>
</comp>
<comp lib="0" loc="(1930,390)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(2000,200)" name="Tunnel">
<a name="label" val="SRV"/>
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<comp lib="0" loc="(2050,350)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="bit6" val="1"/>
<a name="bit7" val="1"/>
<a name="facing" val="south"/>
<a name="incoming" val="8"/>
</comp>
<comp lib="0" loc="(2050,390)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="H"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(2080,390)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="L"/>
<a name="width" val="4"/>
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<comp lib="0" loc="(210,780)" name="Constant"/>
<comp lib="0" loc="(260,1080)" name="Constant">
<a name="value" val="0xaa"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(260,800)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(280,1220)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="H"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(290,1080)" name="Tunnel">
<a name="label" val="Eingabe"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(290,930)" name="Clock"/>
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<a name="label" val="RST"/>
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<comp lib="0" loc="(320,930)" name="Tunnel">
<a name="label" val="CLK"/>
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<comp lib="0" loc="(330,1220)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="L"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(380,440)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="SAVE"/>
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<comp lib="0" loc="(430,460)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(660,620)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="SAVE"/>
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<comp lib="0" loc="(70,600)" name="Constant">
<a name="width" val="8"/>
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<comp lib="0" loc="(740,480)" name="Tunnel">
<a name="facing" val="south"/>
<a name="label" val="SRV"/>
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<comp lib="0" loc="(760,620)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="JMP"/>
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<comp lib="0" loc="(840,190)" name="Splitter">
<a name="facing" val="south"/>
<a name="fanout" val="3"/>
<a name="incoming" val="3"/>
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<comp lib="0" loc="(860,830)" name="Tunnel">
<a name="facing" val="north"/>
<a name="label" val="load"/>
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<comp lib="1" loc="(1060,240)" name="NOT Gate"/>
<comp lib="1" loc="(1140,440)" name="NOR Gate">
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<comp lib="1" loc="(1150,550)" name="NOR Gate">
<a name="inputs" val="3"/>
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<comp lib="1" loc="(1150,670)" name="NOR Gate">
<a name="inputs" val="3"/>
</comp>
<comp lib="1" loc="(1180,240)" name="NOR Gate">
<a name="inputs" val="3"/>
</comp>
<comp lib="1" loc="(1180,330)" name="AND Gate">
<a name="inputs" val="3"/>
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<comp lib="1" loc="(1260,470)" name="OR Gate"/>
<comp lib="1" loc="(1270,410)" name="OR Gate"/>
<comp lib="1" loc="(1390,580)" name="OR Gate">
<a name="size" val="30"/>
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<comp lib="1" loc="(1440,580)" name="NOT Gate"/>
<comp lib="1" loc="(1980,200)" name="NAND Gate">
<a name="inputs" val="8"/>
<a name="size" val="30"/>
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<comp lib="1" loc="(640,510)" name="NOT Gate">
<a name="facing" val="south"/>
</comp>
<comp lib="1" loc="(660,600)" name="AND Gate">
<a name="facing" val="south"/>
<a name="inputs" val="3"/>
</comp>
<comp lib="1" loc="(760,600)" name="AND Gate">
<a name="facing" val="south"/>
<a name="inputs" val="4"/>
</comp>
<comp lib="1" loc="(860,760)" name="NOT Gate">
<a name="facing" val="south"/>
</comp>
<comp lib="1" loc="(860,810)" name="AND Gate">
<a name="facing" val="south"/>
<a name="inputs" val="3"/>
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(940,350)" name="NOT Gate"/>
<comp lib="1" loc="(940,650)" name="NOT Gate"/>
<comp lib="1" loc="(990,460)" name="NOT Gate"/>
<comp lib="2" loc="(1440,840)" name="Multiplexer">
<a name="select" val="2"/>
<a name="width" val="8"/>
</comp>
<comp lib="2" loc="(1480,350)" name="Multiplexer">
<a name="select" val="2"/>
<a name="width" val="8"/>
</comp>
<comp lib="2" loc="(190,710)" name="Multiplexer">
<a name="select" val="2"/>
<a name="width" val="8"/>
</comp>
<comp lib="3" loc="(1360,780)" name="Subtractor"/>
<comp lib="3" loc="(1370,730)" name="Adder"/>
<comp lib="3" loc="(1380,380)" name="Subtractor"/>
<comp lib="3" loc="(1390,330)" name="Adder"/>
<comp lib="3" loc="(150,590)" name="Adder"/>
<comp lib="4" loc="(1610,260)" name="RAM">
<a name="appearance" val="logisim_evolution"/>
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<comp lib="4" loc="(1650,810)" name="Register">
<a name="appearance" val="logisim_evolution"/>
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<comp lib="4" loc="(170,130)" name="ROM">
<a name="appearance" val="logisim_evolution"/>
<a name="contents">addr/data: 8 3
6 31*0 6 15*0 7 15*0 7
</a>
<a name="dataWidth" val="3"/>
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<comp lib="4" loc="(1940,320)" name="Register">
<a name="appearance" val="logisim_evolution"/>
</comp>
<comp lib="4" loc="(300,730)" name="Register">
<a name="appearance" val="logisim_evolution"/>
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<comp lib="4" loc="(450,390)" name="Register">
<a name="appearance" val="logisim_evolution"/>
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<comp lib="5" loc="(280,1200)" name="Hex Digit Display"/>
<comp lib="5" loc="(300,1000)" name="Button">
<a name="label" val="RST"/>
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<comp lib="5" loc="(330,1200)" name="Hex Digit Display">
<a name="labelvisible" val="true"/>
</comp>
<comp lib="8" loc="(1094,512)" name="Text">
<a name="text" val="&gt; / ptr++"/>
</comp>
<comp lib="8" loc="(1101,402)" name="Text">
<a name="text" val=". / set"/>
</comp>
<comp lib="8" loc="(1106,607)" name="Text">
<a name="text" val="&lt; / ptr--"/>
</comp>
<comp lib="8" loc="(1120,200)" name="Text">
<a name="text" val="+ / cell[ptr]++"/>
</comp>
<comp lib="8" loc="(1121,292)" name="Text">
<a name="text" val="- / cell[ptr]--"/>
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<comp lib="8" loc="(1138,171)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="ALU"/>
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<comp lib="8" loc="(1679,785)" name="Text">
<a name="text" val="pointer register"/>
</comp>
<comp lib="8" loc="(1688,764)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Brainfuck Logik"/>
</comp>
<comp lib="8" loc="(1696,228)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Zellenblock"/>
</comp>
<comp lib="8" loc="(270,630)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Prozessorlogik"/>
</comp>
<comp lib="8" loc="(275,657)" name="Text">
<a name="text" val="Instruction Pointer"/>
</comp>
<comp lib="8" loc="(287,94)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Programmspeicher"/>
</comp>
<comp lib="8" loc="(299,876)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="I/O Anschlüsse"/>
</comp>
<comp lib="8" loc="(306,1044)" name="Text">
<a name="text" val="Eingabevektor"/>
</comp>
<comp lib="8" loc="(308,971)" name="Text">
<a name="text" val="RESET"/>
</comp>
<comp lib="8" loc="(310,1129)" name="Text">
<a name="text" val="Ausgabevektor"/>
</comp>
<comp lib="8" loc="(312,907)" name="Text">
<a name="text" val="Procssor clock"/>
</comp>
<comp lib="8" loc="(453,334)" name="Text">
<a name="text" val="Load address"/>
</comp>
<comp lib="8" loc="(561,312)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Branch"/>
</comp>
<comp lib="8" loc="(870,95)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Decoder"/>
</comp>
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